シャノン展開された部分関数の特徴に基づく少構成メモリLUT(リコンフィギャラプルアーキテクチャ(2),リコンフィギャラブルシステム,一般)
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概要
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現在,FPGA(Field Programmable Gate Array)の論理セルとしてLUT(Look-Up Table)が広く用いられている.LUTは入力数に応じて任意の論理を実装することが可能であるが,その反面多くの回路資源が必要であり面積が大きい.本稿では,出現頻度の高い論理に対し,シャノン展開を行った際の部分関数間の特徴を利用したSLM(Scalablity Logic Module)アーキテクチャを提案し,既存のLUTとの比較を行った.評価の結果,7-SLM は7-LUTと比較して平均で18%,8-SLMは8-LUTと比較して28%の実装面積を削減することができた.また,面積遅延積に関して,7-SLMは4入力から8入力のLUTよりも良い結果となった.さらに7-SLMは7-LUTと比較して31%の使用構成メモリ数を削減した.
- 一般社団法人電子情報通信学会の論文
- 2013-09-11
著者
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
久我 守弘
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
-
柳田 恭成
熊本大学大学院自然科学研究科
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