配線セグメント長を考慮したSOMベースFPGA配置手法(システムと信号処理及び一般)
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概要
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FPGA(Field Programmable Gate Array)の設計工程において配置は最も時間を要する処理の一つである.FPGA配置問題に対し従来は焼きなまし法(SA:Simulated Annealing)をベースとした解決が行われていたが,大規模回路を実装する際には処理時間が問題となる.そこで我々の研究グループでは,自己組織化マップ(SOM:Self Organizing feature Maps)を用いた配置手法を提案している.SOMは教師なし学習ニューラルネットワークに分類され,競合と協調により勝者ノードの近傍を繰り返し更新することで学習を行う.近傍関係は出力層のニューロンのネットワークトポロジによって決定する.本稿ではFPGAの接続関係を考慮したSOMの出力層を定義し配置を行う.計算機実験では,マルチセグメントを持つ配線構造,および階層的な配線構造の2種類に対し評価を行う.SAベースのVPRと比較して最大遅延が28%悪化したが,実行時間を平均97%改善することができた.さらにSOMとSAを混成した手法では,VPRと比較して最大遅延を平均4%,実行時間を平均29%改善することがわかった.
- 一般社団法人電子情報通信学会の論文
- 2013-07-04
著者
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
久我 守弘
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
-
濱田 哲郎
熊本大学大学院自然科学研究科
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