スイッチブロックのトポロジに着目したFPGAの配線テスト手法(FPGA設計環境とテスト,FPGA応用及び一般)
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概要
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通常のLSIではATPG(Automatic Test Pattern Generation)ツールを利用した出荷テストが行われる.しかし,専用回路のASICとは異なり,実装論理が固定されていないFPGAにはATPGツールが対応していない.このため効率良いテスト,および高いテスト網羅率を得るためには,デバイスアーキテクチャの開発段階でテスト容易化設計(DFT:Design For Testability)が必要となる.本研究ではWiltonスイッチブロックのもつ特徴を利用したテスト容易化なデバイスアーキテクチャおよびそのテスト手法を提案する.配線部を対象として縮退故障検出のためのフォルトカバレッジを計測したところ,5種類のテストパタンを用いて100%のカバレッジを達成した.
- 2011-01-10
著者
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
井上 万輝
熊本大学大学院自然科学研究科
-
飯田 全広
三菱電機エンジニアリング(株)
-
用正 博紀
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
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