故障耐性をもつFPGA-IPコアの提案(開発環境と性能評価,リコンフィギャラブルシステム,一般)
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概要
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本論文ではシステム二LSIに搭載するFPGA-IPコアを対象に,物理故障に対し耐故障性をもつFPGAアーキテクチャの提案を行う.本提案IPコアは(1)設計用途に応じたスケーラビリティをもち,(2)アーキテクチャレベルで故障回避を行う点を特徴としている.提案FPGA-IPコアは複数のタイルアレイ領域に分割される.タイルアレイは通常のFPGAと同様のタイルおよび故障回避用のスペアタイルで構成される.ひとたび故障を検出すると,タイルアレイ内にて列単位で回路構成情報をシフトし故障回避を行う.様々なタイルアレイサイズにおいて回路性能と故障耐性に関する評価を行った結果,タイル総数の1%までの故障に対し約90%の故障回避成功率が得られることがわかった.この際,通常のFPGAと比較した場合の性能低下は面積で2.2倍,速度で1.3倍に抑えることができた.
- 一般社団法人電子情報通信学会の論文
- 2013-05-13
著者
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
久我 守弘
熊本大学大学院自然科学研究科
-
趙 謙
熊本大学大学院自然科学研究科
-
井上 万輝
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
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