ソフトコアプロセッサシステムの高信頼化に向けたコンテキスト同期手法(信頼性,非同期)
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概要
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SRAM型FPGAは,再構成可能という特徴を持つ反面,ソフトエラーにより回路構成が破壊される恐れがある.著者らは,これまでに三重冗長化,部分再構成および割込みを用いたコンテキスト同期を組合わせたソフトコアプロセッサの高信頼化手法を提案している.本論文では,ペリフェラル部分を対象とした再構成手法,およびコンテキスト同期手法を提案することで,システム全体の高信頼化を行った.その結果,先行研究と比較して,FIT (Failure In Time)を43.4%減少できることが分かった.
- 2011-05-05
著者
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
久我 守弘
熊本大学大学院自然科学研究科
-
尼崎 太樹
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
甲斐 統貴
熊本大学大学院自然科学研究科
-
一ノ宮 佳裕
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
-
藤野 誠
熊本大学大学院自然科学研究科
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