SGTとFinFETを用いた論理回路のパターン面積の比較検討(プロセス・デバイス・回路シミュレーション及び一般)
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概要
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本論文では初めてSGTとFinFETを用いて設計した種々の回路方式の全加算器のパターン面積を定量的に比較した.チャネル幅の小さな(デザインルールFの8倍)トランジスタを用いて設計した場合は,いずれの回路方式でもSGTを用いた方がパターン面積を5〜20%程度縮小できることがわかった.また,高速動作を指向したシステムLSIや,将来の最先端プロセス技術を用いたシステムLSIでは,SGTとFinFETのパターン面積の差が縮小する可能性がある事がわかった.
- 一般社団法人電子情報通信学会の論文
- 2011-11-03
著者
-
小玉 貴大
湘南工科大学工学部情報工学科
-
渡辺 重佳
湘南工科大学工学部情報工学科
-
渡辺 重佳
湘南工科大学大学院工学研究科
-
渡辺 重佳
情報工学科
-
小玉 貴大
湘南工科大学大学院工学研究科
-
小玉 貴大
湘南工科大学
-
渡辺 重佳
湘南工科大学
-
渡辺 重佳
湘南工科大学 工学部 情報工学科
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