High Speed and Noise Tolerant Parallel Bus Interface for VLSI Systems Using Multi Bit Code Division Multiple Access(<Special Section>New System Paradigms for Integrated Electronics)
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概要
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An efficient data transmission interface for VLSI systems, Multi-Bit Parallel Code Division Multiple Access (MB/P-CDMA) interface, has been designed with 0.35 μm CMOS technology. The proposed interface achieves 1.12Gb/s data rate (80MHz, 8 bit bus) using multi-bit transmission at each clock per transmitter. The proposed CDMA interface ensures higher speed operation than conventional interface even in noisy environments. Each of the transmitters and receivers occupies the die area of 290×360μm^2 and 240×280μm^2, respectively.
- 社団法人電子情報通信学会の論文
- 2004-11-01
著者
-
Taniguchi Kenji
Department Of Electrical Electronic And Information Engineering Osaka University
-
Matsuoka T
Department Of Electrical Electronic And Information Engineering Osaka University
-
Matsuoka T
Osaka Univ. Osaka Jpn
-
Matsuoka Toshimasa
The Graduate School Of Engineering Osaka University
-
MATSUOKA Toshimasa
Graduate School of Engineering, Osaka University
-
TANIGUCHI Kenji
Graduate School of Engineering, Osaka University
-
SHIMIZU Shinsaku
Graduate School of Engineering, Osaka University
-
Taniguchi Kenji
The Division Of Electrical Electronic And Information Engineering Osaka University
-
Taniguchi K
Department Of Electronics And Information Systems Osaka University
-
Taniguchi K
Division Of Electrical Electronics And Information Engineering Graduate School Of Engineering Osaka
-
Taniguchi K
Kyushu Univ.
-
Shimizu Shinsaku
Graduate School Of Engineering Osaka University
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