入出力相互コンダクタンス及び位相補償容量を可変とする可変利得増幅器の低消費電力化に関する検討(電子回路)
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概要
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2段構成演算増幅器を用いたスイッチトキャパシタ型可変利得増幅器(PGA : Programmable Gain Amplifier)の低消費電力化手法を提案する.演算増幅器の入力相互コンダクタンスと位相補償容量をPGAの利得に応じて制御し,更に,出力相互コンダクタンスも可変にすることで,高い電力効率で全利得に対して帯域と安定性を満たす可変利得増幅器を実現した.0.25μm CMOSプロセスを用い動作速度が40 MSps,利得幅が0〜30dBのPGAを設計した.シミュレーション結果より,可変利得増幅器の消費電流はPGAの利得に応じて,最大で28.6mA,最小で11.0mAとなった.また,出力換算ノイズの二乗平均平方根(RMS)は同様に最大で2.2 mVrms,最小で133.6μVrmsとなった.
- 2012-07-01
著者
-
松岡 俊匡
大阪大学大学院工学研究科
-
谷口 研二
大阪大学大学院工学研究科
-
松岡 俊匡
大阪大学
-
谷口 研二
大阪大学大学院工学研究科高度人材育成センター:大阪大学大学院工学研究科電気電子情報工学専攻
-
大倉 鉄郎
大阪大学大学院工学研究科
-
大倉 俊介
Division Of Electrical Electronic And Information Engineering Osaka University
-
松岡 俊匡
大阪大学大学院工学研究科電子情報エネルギー工学専攻
-
谷口 研二
大阪大
-
Taniguchi K
Osaka Univ. Osaka Jpn
-
Taniguchi K
Department Of Electronics And Information Systems Osaka University
-
Taniguchi K
Division Of Electrical Electronics And Information Engineering Graduate School Of Engineering Osaka
-
大倉 鉄郎
大阪大学
-
Taniguchi Kenji
Division Of Electrical Electronic And Information Engineering Osaka University
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