A 0.5V Area-Efficient Transformer Folded-Cascode CMOS Low-Noise Amplifier
スポンサーリンク
概要
- 論文の詳細を見る
A 0.5V transformer folded-cascode CMOS low-noise amplifier (LNA) is presented. The chip area of the LNA was reduced by coupling the internal inductor with the load inductor, and the effects of the magnetic coupling between these inductors were analyzed. The magnetic coupling reduces the resonance frequency of the input matching network, the peak frequency and magnitude of the gain, and the noise contributions from the common-gate stage to the LNA. A partially-coupled transformer with low magnetic coupling has a small effect on the LNA performance. The LNA with this transformer, fabricated in a 90nm digital CMOS process, achieved an S11 of -14dB, NF of 3.9dB, and voltage gain of 16.8dB at 4.7GHz with a power consumption of 1.0mW at a 0.5V supply. The chip area of the proposed LNA was 25% smaller than that of the conventional folded-cascode LNA.
- （社）電子情報通信学会の論文
- 2009-04-01
著者
-
Taniguchi Kenji
Department Of Electrical Electronic And Information Engineering Osaka University
-
Matsuoka T
Department Of Electrical Electronic And Information Engineering Osaka University
-
Matsuoka T
Osaka Univ. Osaka Jpn
-
Matsuoka Toshimasa
The Graduate School Of Engineering Osaka University
-
TANIGUCHI Kenji
Division of Electrical, Electronic and Information Engineering, Osaka University
-
Taniguchi Kenji
Division Of Electrical Electronics And Information Engineering Graduate School Of Engineering Osaka
-
Taniguchi Kenji
The Division Of Electrical Electronic And Information Engineering Osaka University
-
MATSUOKA Toshimasa
Division of Electrical, Electronics and Information Engineering, Osaka University
-
Park Hae-ju
Division Of Electrical Electronics And Information Engineering Graduate School Of Engineering Osaka
-
Taniguchi K
Department Of Electronics And Information Systems Osaka University
-
Taniguchi K
Division Of Electrical Electronics And Information Engineering Graduate School Of Engineering Osaka
-
Kihara Takao
Division Of Electrical Electronics And Information Engineering Graduate School Of Engineering Osaka
-
TAKOBE Isao
Division of Electrical, Electronics and Information Engineering, Graduate School of Engineering, Osa
-
YAMASHITA Fumiaki
Division of Electrical, Electronics and Information Engineering, Graduate School of Engineering, Osa
-
Takobe Isao
Division Of Electrical Electronics And Information Engineering Graduate School Of Engineering Osaka
-
Taniguchi Kenji
Division Of Electrical Electronic And Information Engineering Osaka University
-
Yamashita Fumiaki
Division Of Electrical Electronics And Information Engineering Graduate School Of Engineering Osaka
-
Matsuoka Toshimasa
Division Of Electrical Electronics And Information Engineering Osaka University
関連論文
- TDCを用いたオーディオ用ADコンバータの設計検討
- A High Efficiency Variable Gain Amplifier Circuit with Controllable Transconductance Amp
- 自己発熱効果がナノスケールトランジスタの電気特性に与える影響(プロセス・デバイス・回路シミュレーション及び一般)
- 空間的または時間的に一様でない系におけるトンネリングのシミュレーション(プロセス・デバイス・回路シミュレーション及び一般)
- 量子格子気体法によるデバイス内部の電子波伝搬解析(プロセス・デバイス・回路シミュレーション及び一般)
- 非線形パルス幅変調を用いたTDC-ADCの構成と歪み補正手法の提案
- 二重フィードバックを用いスピーカインピーダンスの影響を低減したオーディオ用D級アンプの設計/評価
- 表面ポテンシャルを用いた薄膜トランジスタのドレイン電流モデル(プロセス・デバイス・回路シミュレーション及び一般)
- ひずみSi-p型電界効果トランジスタのホール伝導特性に関する理論計算
- C-9-3 SoG液晶モジュール用アナログバッファ回路に関する研究(C-9. 電子ディスプレイ,一般セッション)
- Poly-Si TFTにおける容量 : 電圧特性のシミュレーションによる解析(シリコン関連材料の作製と評価)
- 65nmノード歪みpMOSFETのホール伝導における全応力の効果の検証(プロセス・デバイス・回路シミュレーション及び一般)
- 周期的な不純物原子配列を有する半導体の電気伝導シミュレーション(プロセス・デバイス・回路シミュレーション及び一般)
- 数値シミュレーションに基づく10nmチャネル素子の電気伝導機構に関する考察(半導体Si及び関連材料・評価)
- ひずみSi pMOSFETsにおける移動度増大率の計算 : 1軸と2軸応力の比較について(Group IV Compound Semiconductors, 先端デバイスの基礎と応用に関するアジアワークショップ(AWAD2005))
- 15nm以上の膜厚を有するシリコン酸化膜の絶縁破壊統計性(ゲート絶縁膜, 容量膜, 機能膜及びメモリ技術)
- 分子動力学/アンサンブルモンテカルロ法による極微細n-i-nダイオードの電流解析(プロセス・デバイス・回路シミュレーション及び一般)
- P-36 大阪大学における社会人専門教育プログラム : エレクトロニクス産業を支える高度専門技術者の育成((25)高度専門技術者教育、社会人のための大学院工学教育,ポスター発表論文)
- 酸化膜絶縁破壊がMOSFETチャネル電流に与える影響(ゲート絶縁膜,容量膜,機能膜及びメモリ技術)
- 同相除去比を強化した増幅器
- 連続サンプルコンパレータの解析と応用
- C-12-20 連続サンプルコンパレータの解析(C-12. 集積回路C(アナログ), エレクトロニクス2)
- A-1-12 同相除去比を強化した増幅器(A-1. 回路とシステム, 基礎・境界)
- ダイナミックラッチを用いたパイプラインAD変換器用低消費電力コンパレータの一設計
- 周期的な不純物原子配列を有する半導体の電気伝導シミュレーション(プロセス・デバイス・回路シミュレーション及び一般)
- 65nmノード歪みpMOSFETのホール伝導における全応力の効果の検証(プロセス・デバイス・回路シミュレーション及び一般)
- ひずみSi pMOSFETsにおける移動度増大率の計算 : 1軸と2軸応力の比較について(Group IV Compound Semiconductors, 先端デバイスの基礎と応用に関するアジアワークショップ(AWAD2005))
- Column-Parallel ADC に用いる高精度, 小面積 D-Flip-Flop 回路
- C-12-14 小信号モデルを用いた可変利得増幅器用アンプの解析(C-12.集積回路C(アナログ),一般講演)
- 1.5bit量子化器を用いた Active-Passive 積分器による2次CT-DSMの構成法
- Process Variation Compensation Technique for 0.5-V Body-Input Comparator
- A Switched-Capacitor Programmable Gain Amplifier Using Dynamic Element Matching
- Process Variation Compensation Technique for Voltage-controlled Ring Oscillator
- Analytical Expression Based Design of a Low-Voltage FD-SOI CMOS Low-Noise Amplifier(Analog Circuit Techniques and Related Topics)
- Small-Signal and Noise Model of Fully Depleted Silicon-on-Insulator Metal-Oxide-Semiconductor Devices for Low-Noise Amplifier
- Accurate Small-Signal Modeling of FD-SOI MOSFETs(Advanced RF Technologies for Compact Wireless Equipment and Mobile Phones)
- A design of gain-boosted folded-cascode CMOS op-amp for SC circuits
- Wired CDMA Interface with Adaptivity for Interconnect Capacitances(Nonlinear Theory and its Applications)
- CMOS Front-End Circuits of Dual-Band GPS Receiver(RF, Analog Circuit and Device Technologies)
- Ultralow-Power Current Reference Circuit with Low Temperature Dependence(Building Block, Analog Circuit and Device Technologies)
- A CMOS IF Variable Gain Amplifier with Exponential Gain Control(Analog Circuit Techniques and Related Topics)
- High Speed and Noise Tolerant Parallel Bus Interface for VLSI Systems Using Multi Bit Code Division Multiple Access(New System Paradigms for Integrated Electronics)
- Watch-Dog Circuit for Quality Guarantee with Subthreshold MOSFET Current(New System Paradigms for Integrated Electronics)
- CMOS Demodulator for Short-Range Wireless Interconnection Using ASK/CDMA Technique(Wide Band Systems)
- Watchdog Circuit for Product Degradation Monitor using Subthreshold MOS Current
- A New Analog Correlator Circuit for DS-CDMA Wireless Applications
- Dynamically Programmable Paralell Processor (DPPP) : A Novel Reconfigurable Architecture with Simple Program Interface(Special Issue on Function Integrated Information Systems)
- Error Analysis on Simultaneous Data Transfers in CDMA Wired Interface
- C-12-26 An Auto-sensitivity Control Circuit for DS-CDMA Receiver Circuit
- A Novel Dynamically Programmable Arithmetic Array(DPAA)Processor for Digital Signal Processing(Special Section of Selected Papers from the 13th Workshop on Circuits and Systems in Karuizawa)
- Poly-Si TFTにおけるゲート酸化膜へのホットホール注入と捕獲/放出特性の評価(シリコン関連材料の作製と評価)
- 空間的または時間的に一様でない系におけるトンネリングのシミュレーション(プロセス・デバイス・回路シミュレーション及び一般)
- 分子動力学/アンサンブルモンテカルロ法による極微細n-i-nダイオードの電流解析(プロセス・デバイス・回路シミュレーション及び一般)
- 量子格子気体法によるデバイス内部の電子波伝搬解析(プロセス・デバイス・回路シミュレーション及び一般)
- A 10-bit 800-Column Low-Power RAM Bank Including Energy-Efficient D-Flip-Flops for a Column-Parallel ADC(Analog Circuit Techniques and Related Topics)
- Design of a 0.5V Op-Amp Based on CMOS Inverter Using Floating Voltage Sources
- Low-Voltage Wireless Analog CMOS Circuits toward 0.5V Operation
- Application of Noise-Enhanced Detection of Subthreshold Signals for Communication Systems
- A New Inductance Extraction Technique of On-Wafer Spiral Inductor Based on Analytical Interconnect Formula(Microelectronic Test Structures)
- A Low-Voltage SOI-CMOS LC-Tank VCO with Double-Tuning Technique Using Lateral P-N Junction Variable Capacitance(Special lssue on Silicon RF Device & Integrated Circuit Technologies)
- A-3-1 A 5Msample/s 0.965-mW Switched-Capacitor Filter in 0.6-μm CMOS Technology
- A-3-3 A 5Ms/s 0.965-mW Switched-Capacitor Integrator in 0.6μm CMOS Technology
- A Transformer Noise-Canceling Ultra-Wideband CMOS Low-Noise Amplifier
- A 0.5V Area-Efficient Transformer Folded-Cascode CMOS Low-Noise Amplifier
- A Low Power Analog Matched-Filter with Smart Sliding Correlation
- A-5-3 Speed-Power-Resolution Tradeoff in Analog Correlator Circuit
- A Reference Voltage Buffer with Settling Boost Technique for a 12bit 18MHz Multibit/Stage Pipelined A/D Converter
- Molecular Dynamics Simulation on Longitudinal Optical Phonon Mode Decay and Heat Transport in a Silicon Nano-Structure Covered with Oxide Films
- チャネル構成の変更可能なオーディオ用D級アンプの設計検討
- パイプライン方式逐次比較型A/Dコンバータにおける消費電力最適化の一手法
- Phenomenological Model for Stress and Relaxation Processes of Resistance Drift in Magnetic Tunnel Junctions
- A Dynamic Dither Gain Control Technique for Multi-Level Delta-Sigma DACs with Multi-Stage Second Order Dynamic Element Matching
- 時間量子化方式ADコンバータにおけるディザの最適化
- Application of Kelvin Technique in A Gas-Sensor Read-Out Circuit
- 逐次比較型ADコンバータのマルチビット化の一手法
- A Switched-Capacitor Programmable Gain Amplifier Using Dynamic Element Matching
- An Area-Efficient, Low-Power CMOS Fractional Bandgap Reference
- poly-Si TFTのオーバーシュートドレイン電流の評価とモデリング(シリコン関連材料の作製と評価)
- A Wide Dynamic Range Variable Gain Amplifier with Enhanced IP1 dB and Temperature Compensation
- A Multi-Stage Second Order Dynamic Element Matching with In-Band Mismatch Noise Reduction Enhancement
- 入出力相互コンダクタンス及び位相補償容量を可変とする可変利得増幅器の低消費電力化に関する検討(電子回路)
- マージド・キャパシタ・スイッチング法を用いたパイプラインA-DコンバータのMDACセグメント内差動キャパシタミスマッチに関する解析
- Characteristics of Hot Hole Injection, Trapping, and Detrapping in Gate Oxide of Polycrystalline Silicon Thin-Film Transistors
- Molecular Dynamics Simulation of Heat Transport in Silicon Nano-structures Covered with Oxide Films
- Surface-Potential-Based Drain Current Model for Polycrystalline Silicon Thin-Film Transistors
- A High Dynamic Range and Low Power Consumption Audio Delta-Sigma Modulator with Opamp Sharing Technique among Three Integrators