1チップマルチプロセッサのデバッグシステム(VSLI一般(ISSCC'03関連特集))
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概要
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異なるタイプの複数のプロセッサを1チップに集積した場合のデバッグシステムを開発した.システムは,チップ内I/F回路,チップとPCを接続するI/F基板,PCに実装されたデバッグシステムからなる.本システムは,オリジナルビデオプロセッサコア,RISC,DSPで構成されるマルチメディア通信LSIに適用した.RISCはオリジナルビデオプロセッサコアと周辺H/Wで構成されるビデオ処理ユニットを制御するが,JTAGベースのI/F回路にトランザクション用のコマンド/アドレス/データレジスタとシーケンサーを実装することで,デバックモードにおいて,外部デバッガからRISCと同等の制御を行うことを実現した.ビデオ処理ユニットと他のユニットを平易王してデバッグすることにより,効率的なデバッグと帰還短縮を実現した.
- 社団法人電子情報通信学会の論文
- 2003-05-21
著者
-
浅野 研一
三菱電機株式会社情報技術総合研究所
-
鈴木 弘一
三菱電機(株)情報技術総合研究所
-
浅野 研一
三菱電機(株) 情報技術総合研究所
-
峯岸 孝行
三菱電機株式会社情報技術総合研究所
-
峯岸 孝行
三菱電機(株)情報技術総合研究所
-
岡田 圭介
(株)ルネサステクノロジー製品技術本部
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