ED2000-120 / SDM2000-102 / ICD2000-56 MPEG4/H26x 30fr/sビデオ処理可能な低消費電力メディアプロセッサコア アーキテクチャ
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概要
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MPEG4/H26xのビデオ符号化および復号化に適したメディアプロセッサコアアーキテクチャの検討を行った。8並列SIMD型プロセッサ、単一演算プロセッサ、VLCプロセッサを備え、フレキシブルなDMAデータ転送可能なアーキテクチャをとる。8×8 2D-DCTを132クロックサイクル、動き補償の歪計算(16*16画素)を24クロックサイクルで実現するなど、ビデオ処理で演算性能を必要とする処理に対して、効率的に実行可能であり、100MHz動作で、MPEG4/H26xのビデオ符号化および復号化をCIF 30fr/s実行できる。さらに低消費電力化アーキテクチャにより、CIF 30fr/sを280mWで実現できる見積もりである。本報告では、メディアプロセッサコアのアーキテクチャおよび処理性能および消費電力見積もりについて検討した。
- 社団法人電子情報通信学会の論文
- 2000-08-17
著者
-
浅野 研一
三菱電機株式会社情報技術総合研究所
-
吉本 雅彦
三菱電機株式会社システムLSI開発研究所
-
鈴木 弘一
三菱電機(株)情報技術総合研究所
-
大平 英雄
三菱電機株式会社情報技術総合研究所
-
亀丸 敏久
三菱電機株式会社情報技術総合研究所
-
吉本 雅彦
三菱電機株式会社情報技術総合研究所
-
吉本 雅彦
三菱電機株式会社lsi研究所
-
鈴木 弘一
三菱電機株式会社系統変電・交通システム事業所
-
大平 英雄
三菱電機株式会社通信システム研究所
-
吉本 雅彦
三菱電機(株)情報技術総合研究所
-
亀丸 敏久
三菱電機株式会社情報通信システム開発センター
-
亀丸 敏久
三菱電機株式会社
-
鈴木 弘一
三菱電機株式会社情報技術総合研究所
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