同期終了検出型加算器を用いた疑似非同期式マイクロプロセッサの設計
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概要
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本報告では、平均的な演算時間の向上を目指した終了検出型加算器Split Ripple Carry Adderの検討を行ない、同期方式向けの最大遅延削減による高速化を図る加算回路よりもハードウェア量あたりで平均的に高速に演算が可能であることを示した。この終了検出型加算器を活用するために疑似非同期マイクロプロセッサの検討を行なった。この疑似非同期方式は大域クロックを用いながら、ブロック毎に可変遅延を備えたオートマトンを用いて制御することで、クロックスキューの影響を受けない方式である。本方式により、可変時間終了型加算器や極端に遅延時間の大きなブロック(Load,Store Unit)を用いた場合でもパイプラインの効率が74%となるマイクロプロセッサの構成が可能であることがわかった。
- 社団法人電子情報通信学会の論文
- 1995-09-13
著者
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