ラッチ型センスアンプのCPL回路への応用
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概要
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VLSI論理回路高速化の手法として、CPL(Complementary Pass-Transistor Logic)の信号増幅にラッチ型センスアンプを用いた回路を提案する。センスアンプを使うことで微小な電位差を高速に増幅することができる。また、センスアンプを駆動するタイミング信号の生成回路を示す。
- 社団法人電子情報通信学会の論文
- 1996-09-18
著者
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