1.5Vソース結合形電流モード多値集積回路とその高速パイプライン乗算器への応用
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概要
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サブミクロンVLSIシステムでは、配線問題の解決と共に、高信頼性や低消費電力性の観点から電源電圧の低減が重要な課題である。多値集積回路は、配線問題を本質的に解決する有力な一手法であるが、低電圧化を考慮した回路構成方法についてはほとんど議論されていなかった。本稿では、2線相補信号で並列駆動させるソース結合形回路が高い電流駆動能力を有することに着目し、低電圧時においても高速に動作するソース結合形電流モード多値集積回路を提案する。本回路方式に基づく2進SD数加算器は、2値CMOS回路による構成と比較した結果、1.3倍の高速化が達成されている。さらに大規模な算術演算システムへの応用において、低消費電力の観点からパイプライン化が有効となるため、これを2値CMOS回路のダイナミック記憶方式を活用し回路規模を大きくすることなく実現できる。一例として、パイプライン乗算器を構成した場合、1.5V電源電圧の下で、2値回路に基づく構成より1.4倍の高速化が達成されることを明らかにしている。
- 社団法人電子情報通信学会の論文
- 1995-04-27
著者
-
亀山 充隆
東北大学大学院情報科学研究科
-
羽生 貴弘
東北大学大学院情報科学研究科
-
望月 明
Research Institute Of Electrical Communication Tohoku University
-
望月 明
東北大学大学院情報科学研究科
-
Mochizuki Akira
The Research Institute Of Electrical Communication Tohoku University
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