ブロック反復法による電源回路網解析の高速化(配置配線,デザインガイア2011-VLSI設計の新しい大地-)
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概要
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半導体プロセスの微細化が進み,電源回路網の解析が重要になっている.また,電源回路網それ自体の規模も大きく,今後のさらなる巨大化に対応するためにも,回路解析の高速化,省メモリ化か大きな課題となっている.ブロック反復法は直接法と反復法を組み合わせた解析方法であり,大規模電源回路網解析への応用が期待されている.本稿ではブロック反復法の高速化を目的として,SOR法およびブロック分割の観点から収束の加速方法を検討する.
- 2011-11-21
著者
-
越智 裕之
京都大学大学院情報学研究科
-
筒井 弘
大阪大学大学院情報科学研究科情報システム工学専攻
-
筒井 弘
京都大学大学院情報学研究科通信情報システム専攻
-
佐藤 高史
京都大学大学院情報学研究科通信情報システム専攻
-
佐藤 高史
京都大学大学院情報学研究科
-
越智 裕之
京都大学大学院 情報学研究科 通信情報システム専攻
-
森下 拓海
京都大学大学院情報学研究科通信情報システム専攻
-
佐藤 高史
京大 大学院情報学研究科
-
筒井 弘
京都大学大学院情報学研究科
-
森下 拓海
京都大学大学院情報学研究科
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