CMOSデジタルLSIにおける電源雑音評価のためのリファレンス回路(デザインガイア2009-VLSI設計の新しい大地)
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概要
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近年の微細化の進展により,VLSIの電源供給系のダイナミック雑音を正確に理解することが強く要求されている.本論文ではCMOS技術を用いたプロセス間で移植が容易なダイナミック雑音を評価するためのリファレンス回路を提案する.この回路を用いることでダイナミック電源雑音の発生を良く理解することができる.提案回路はループシフトレジスタを基本とする構成である.実際にこの回路を実装したテストチップを0.18umと90nmのCMOSプロセスを用いて試作し,ダイナミック電源雑音の評価を行った.また,寄生容量成分の充電過程を雑音発生の基本としたモデリングを用いて解析を合わせて実施した.その結果,電源,グラウンド,基板雑音の実測結果と解析結果の間で良好な整合性を得られた.
- 社団法人電子情報通信学会の論文
- 2009-11-25
著者
-
永田 真
神戸大学大学院工学研究科情報知能学専攻
-
松野 哲郎
神戸大学
-
小坂 大輔
株式会社A-R-Tec
-
永田 真
神戸大学:株式会社a-r-tec
-
松野 哲郎
神戸大学情報知能工学科
-
小坂 大輔
神戸大学情報知能工学科
-
永田 真
神戸大学情報知能工学科
-
永田 真
神戸大 大学院システム情報学研究科
-
松野 哲郎
神戸大学 情報知能工学科
-
小坂 大輔
神戸大学 情報知能工学科
-
永田 真
神戸大学工学部
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