再構成可能デバイスMPLDのアーキテクチャ評価(FPGAアーキテクチャー, FPGA応用及び一般)
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概要
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本稿では再構成可能デバイス実現のためのアーキテクチャであるMPLDの詳細構造の評価検討を行う.MPLDは,多数の小容量メモリ間をアドレス線とデータ線の対(AD対)で実現した双方向線を用いて相互に接続した構成となっている.MPLDではこの小容量メモリをMLUTと呼び,論理を実現するLUTとして利用するほか, AD対同士をつなぐスイッチとして用いることでLUT間の配線としても利用する.そのため, MLUT当たりのAD対の数, AD対同士の接続パターンかMPLDにマッピングできる回路の規模,動作遅延に大きな影響を与える.そこで, MLUT当たりのAD対の数, AD対同士の接続パターンなどを変えた多様なMPLDアーキテクチャを仮定し,回路を構成するための特性の比較を行う.
- 一般社団法人電子情報通信学会の論文
- 2013-01-09
著者
-
石黒 隆
太陽誘電株式会社
-
稲木 雅人
東京工業大学理工学研究科集積システム専攻
-
弘中 哲夫
広島市立大学
-
谷川 一哉
広島市立大学大学院情報科学研究科
-
稲木 雅人
広島市立大学大学院 情報科学研究科
-
石黒 隆
太陽誘電 (株)
-
山下 智也
広島市立大学大学院情報科学研究科情報工学専攻
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