ディジットシリアル演算を導入した再構成型アーキテクチャの性能評価(リコンフィギャラブルシステム2,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
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概要
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我々はRISCプロセッサと,ストリーミング的に処理を行う動的再構成型アーキテクチャであるDS-HIEアーキテクチャで構成されたコアアーキテクチャについて研究を行っている.このアーキテクチャをHybrid DS Core(以降Hy-DiSC)アーキテクチャと呼ぶ.本稿ではJPEGのエンコード処理を実装し,RISCプロセッサのみで処理を実行した場合とHy-DiSCアーキテクチャで処理を実行した場合を比較して面積,処理性能がどの程度向上できるのか評価を行う.JPEGのエンコード処理はストリーミング的に実行が可能なDCT処理を持っているため,DCT処理をDS-HIEアーキテクチャで実行することで処理性能の向上を目指す.評価の結果,Hy-DiSCアーキテクチャではDCT処理部分を比較するとRISCプロセッサに比べ4.32倍,JPEGエンコード処理全体では約1.55倍処理性能が向上することが分かった.そして,DS-HIEアーキテクチャはCore2 Duoのコア1つ分のトランジスタ数に比べて,およそ11分の1のトランジスタ数で実装が可能ということも分かった.
- 社団法人電子情報通信学会の論文
- 2007-11-15
著者
-
谷川 一哉
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学
-
内田 琢郎
広島市立大学大学院情報科学研究科
-
頭山 哲也
広島市立大学大学院
-
谷川 一哉
広島市立大学大学院情報科学研究科
-
弘中 哲夫
広島市立大学大学院情報科学研究科
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