ハイパスカラ・プロセッサ・アーキテクチャ : 動作原理および性能評価
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概要
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本論文は,従来の命令レベル並列処理方式である (1) 命令パイプライン方式, (2) スーパスカラ方式, (3) VLIW方式,および, (4) ベクトル処理方式それぞれの短所排し長所を包括したアーキテクチャとして,ハイパスカラ・プロセッサ・アーキテクチャ (:以下,ハイパスカラ方式) を提案している.ハイパスカラ方式とは,i) 命令長および命令フェッチ幅はスーパスカラ方式と同程度だが,ii) 機能ユニット対応に1個以上のユーザ可視の命令レジスタを設け,それに命令をロードすることでVLIWプログラムをプロセッサ内部に自己形成し,あたかもVLIWプロセッサの如く振舞い,iii) さらに,ベクトル・レジスタを設け,自己形成したVLIW命令のループにより,ベクトル・データに対して疑似ベクトル処理あるいはソフトウェア・パイプライニング処理を施す,ことを目的としたプロセッサ・アーキテクチャである.本論文では,まず,ハイパスカラ方式の基本構成,動作原理,および,活用方法について提示している.次に,ハイパスカラ方式により達成可能な性能を評価している.その結果,スーパスカラ・プロセッサの1.32倍,従来型のベクトル・プロセッサに比べて1.09倍,そして,VLIWプロセッサに比べて0.99倍の性能向上が可能であることを示している.
- 一般社団法人情報処理学会の論文
- 1995-08-15
著者
-
村上 和彰
九州大学大学院システム情報科学府
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学
-
斎藤 靖彦
九州大学大学院総合理工学研究科情報システム学専攻
-
宮嶋 浩志
九州大学大学院システム精報科学研究科情報工学専攻
-
宮嶋 浩志
九州大学 大学院システム情報科学研究科 情報工学専攻
-
村上 和彰
九州大学大学院 システム情報科学研究院 情報理学部門
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