キャッシュ・ミス頻発命令を考慮したメモリ・システムの高性能化(キャッシュメモリ)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
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概要
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マイクロプロセッサと主記憶との動作周波数差は,年々拡大する一方である.両者の周波数差は,マイクロプロセッサの性能阻害要因であり,一般的にメモリ・ウォール問題と呼ばれる.本稿では,メモリウォール問題の解決策のうち,再計算に基づくメモリ・システム高性能化手法CCC (Computing Centric Computation)を提案する.CCCは,キャッシュ・ミス頻発命令を実行する代わりに再計算を行なうことで,主記憶へのアクセス回数を削減する.本稿では,生能向上が得られる可能性があるかどうかに関する予備的な評価を行なった.評価対象ベンチマークにおいて最大45.3%の実行サイクル数削減率を達成した.
- 一般社団法人情報処理学会の論文
- 2004-12-01
著者
-
井上 弘士
九州大学大学院システム情報科学府
-
村上 和彰
九州大学大学院システム情報科学府
-
三輪 英樹
富士通株式会社
-
フェヘイラ ヴィクトル
九州大学大学院システム情報科学研究院
-
フェヘイラ ヴィクトル・マウロ・グラール
九州大学大学院システム情報科学研究院
-
村上 和彰
九州大学 情報基盤センター
-
井上 弘士
九州大学
-
三輪 英樹
九州大学
-
堂後 靖博
福岡大学
-
堂後 靖博
福岡大学大学院工学研究科
-
村上 和彰
九州大学
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