メモリアクセスの特徴を活用した高速かつ正確なメモリアーキテクチャ・シミュレーション法(プロセッサシミュレーション)
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概要
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本稿では,高速かつ正確なメモリアーキテクテャ・シミュレーション法を提案する.一般に,メモリアーキテクチャの評価には,メモリ参照のアドレス・トレースに基づいたシミュレーションを行う.しかしながら,評価対象の増加により,評価時間が長くなる傾向にある.トレースに基づくシミュレーションにおいて,1回あたりのシミュレーション時間はアドレス・トレースの削減によって短縮できるが,精度が低下するという問題がある.そこで,本手法はメモリアクセスの特徴を活用して高い精度維持しつつトレース・サイズを削減し,シミュレーション時間の短縮を実現する.キャッシュ性能測定に基づく評価実験の結果,本手法はトレース・サイズを平均98.8%削減し,そのときのキャッシュ・ミス率の予測誤差は平均0.067パーセンテージ・ポイントであった.
- 一般社団法人情報処理学会の論文
- 2007-08-15
著者
-
井上 弘士
九州大学大学院システム情報科学府
-
村上 和彰
九州大学大学院システム情報科学府
-
村上 和彰
九州大学:戦略的創造研究推進事業
-
小野 貴継
九州大学大学院システム情報科学府
-
井上 弘士
九州大学大学院システム情報科学研究院
-
Inoue K
Kyushu
-
Murakami K
Department Of Informatics Kyushu University
-
村上 和彰
九州大学大学院 システム情報科学研究院 情報理学部門
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