キャッシュウェイ割り当てとコード配置の同時最適化によるメモリアクセスエネルギーの削減(プロセッサ,DSP,画像処理技術及び一般)
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概要
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本稿ではシングルコアプロセッサで実行されるマルチタスクにおいて,キャッシュウェイの割り当てとコード配置を同時に最適化する手法の提案を行う.同時には一つの割り当てられたキャッシュウェイのみを活性化し,残りのキャッシュウェイは活性化しないことでセットアソシアティブキャッシュへのアクセスエネルギーを削減可能である.また,主記憶上のプログラムコードの配置位置を変えることでキャッシュミス数を削減する.キャッシュミス数を削減することで主記憶へのアクセスエネルギーを削減可能であると同時に,全実行時間の短縮が可能である.商用プロセッサを用いた実験によって本手法を適用したプロセッサシステムの評価を行い,手法適用前の場合と比較して最大で17%の消費エネルギーの削減を確認した.
- 2011-10-17
著者
-
井上 弘士
九州大学大学院システム情報科学府
-
井上 弘士
九州大学大学院システム情報科学研究院
-
Inoue K
Kyushu
-
井上 弘士
九大 大学院システム情報科学研究院
-
石原 亨
京都大学大学院情報学研究科
-
高田 純司
九州大学大学院システム情報科学府
-
石原 亨
京都大学大学院 情報学研究科
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