チップマルチプロセッサにおけるキャッシュメモリの特性解析(ARC-5:キャッシュ,2006年並列/分散/強調処理に関する『高知』サマー・ワークショップ(SWoPP 高知2006))
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概要
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近年,より高い性能の実現を目的として1つのチップ上に複数のプロセッサコアを搭載したCMP(Chip MultiProcessor)アーキテクチャが注目されている.メモリバンド幅の制約,メモリウォール問題のさらなる深刻化を背景として,今後プロセッサシステムの高性能化を実現するには,CMPに適したメモリシステムを構築することは不可欠となる.メモリシステムの中でもオンチップ・キャッシュの構成は性能に与える影響が大きく,その主な設計選択肢としてプロセッサコア間での共有/非共有がある.本稿では,CMPにおけるキャッシュの共有と非共有によるメモリ性能への影響を解析し,L2キャッシミス率の差によりメモリ性能の優劣が異なる事を明らかにした.
- 一般社団法人情報処理学会の論文
- 2006-07-31
著者
-
井上 弘士
九州大学大学院システム情報科学府
-
村上 和彰
九州大学大学院システム情報科学府
-
村上 和彰
九州大学:戦略的創造研究推進事業
-
井上 弘士
九州大学大学院システム情報科学研究院
-
三原 智伸
九州大学大学院システム情報科学府
-
Murakami K
Department Of Informatics Kyushu University
-
村上 和彰
九州大学大学院 システム情報科学研究院 情報知能工学部
-
村上 和彰
九州大学大学院 システム情報科学研究院 情報理学部門
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