キャッシュ・ミス頻発ロード命令を対象としたミス原因解析(高速化手法, SWOPP武雄2005 (2005年並列/分散/協調処理に関する「武雄」サマー・ワークショップ))
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概要
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近年, マイクロプロセッサの性能は半導体製造技術の進歩に伴い飛躍的に向上した.その一方で, 主記憶として利用されるDRAMは構造的に高速化しにくく, 今やその速度はマイクロプロセッサよりも約100倍遅い.このような状況では, 主記憶がマイクロプロセッサの性能を抑制するという問題(メモリ・ウォール問題)の解決がコンピュータ・システム性能向上の大きな鍵となる.現在, 筆者らの研究グループではキャッシュ・ミスを頻発させるロード命令に着目してキャッシュ・ミス・ペナルティを低減する技術を開発中である.キャッシュ・ミス頻発ロード命令は全キャッシュ・ミスの約90%を発生させ性能へ大きな影響を与える.本稿では, このロード命令によるキャッシュ・ミスの原因を明らかにするために, 複数のベンチマーク・プログラムに関してメモリ・アクセス・パタンの調査を行なった.その結果, キャッシュ・ミス・頻発ロード命令のロード対象データの殆どは, プログラム実行中に一旦ストアされたデータであることが判明した.
- 社団法人電子情報通信学会の論文
- 2005-07-29
著者
-
井上 弘士
九州大学大学院システム情報科学府
-
村上 和彰
九州大学大学院システム情報科学府
-
三輪 英樹
富士通株式会社
-
三輪 英樹
九州大学大学院システム情報科学府
-
堂後 靖博
福岡大学大学院工学研究科
-
村上 和彰
九州大学大学院 システム情報科学研究院 情報理学部門
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