階層型多バンクメモリを用いた多ポートキャッシュの設計
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概要
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近年,計算機の高並列化への要求が高まるのに伴い,キャッシュに対して大容量と高バンド幅の両立が要求されている.そこで,これまでに我々は高バンド幅と高面積効率を同時に実現する階層型多バンクメモリアーキテクチャ(HMA:Hierarchical Multi-port memory Architechture)を提唱している.本稿では,このHMAを用いた多ポートキャッシュの5層配線0.18μm COMS技術における設計例と,命令/データキャッシュを統合する考え方について議論する.今回設計したテストチップは,4ポートキャッシュを想定した4ポート階層型多バンクメモリで,バンク容量1KB,ワード幅32bit,チップ面積の制限により,バンク数は4である.シミュレーションによるテストチップのバンク応答時間は,2.2nsであったが,設計後のクリティカルパスの最適化により,シミュレーションによる応答時間を約1.2nsにまで短縮することができた.更に,本稿では,多ポートキャッシュの重要な適用例である命令/データ統合型キャッシュについて,多バンクメモリによる新しいアーキテクチャの提案をする.
- 社団法人電子情報通信学会の論文
- 2002-11-21
著者
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
マタウシュ ハンス
広島大学ナノデバイス・バイオ融合科学研究所
-
小出 哲士
広島大学ナノデバイス・システム研究センター
-
上口 光
広島大学
-
上口 光
広島大学ナノデバイス・システム研究センター
-
朱 兆旻
広島大学ナノデバイス・システム研究センター
-
平川 泰
広島市立大学情報科学科
-
弘中 哲夫
広島市立大学
-
マタウシュ ハンス
広島大学ナノデバイス・システム研究センター
-
弘中 哲夫
広島市立大学大学院情報科学研究科
-
平川 泰
広島市立大学
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