可変パイプライン手法によるプロトタイプ低消費エネルギープロセッサの設計(CPSY-5 マイクロアーキテクチャ)(2004年並列/分散/協調処理に関する「青森」サマーワークショップ(SWoPP青森2004))
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概要
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現在プロセッサには高性能と低消費エネルギーの両立が求められている.しかし,現在広く用いられているDVSのような電源電圧に依存した低消費エネルギー手法では将来的にエネルギー削減効率が低下する.そこで電源電圧に依存しないアーキテクチャレベルの低消費エネルギー手法であるVSP(Variable Stages Pipeline)を提案する.VSPは動的にパイプライン段数を変更して実行時間を削減すると同時に,LDS-cell(Latch D-FF Selector-cell)と呼ばれる素子を用いてステージ統合時に増加する組合せ回路内のグリッチを緩和して高性能と低消費エネルギーの両立をはかる.本論文ではVSP手法を用いたプロトタイププロセッサを設計し,他の低消費エネルギー手法を用いたプロセッサと比較した.その結果,VSP手法を用いたプロセッサは従来手法と比較して高性能と低消費エネルギーの両立が達成できることが分かった.
- 社団法人電子情報通信学会の論文
- 2004-07-25
著者
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
近藤 利夫
三重大学大学院工学研究科
-
弘中 哲夫
広島市立大学
-
北村 俊明
広島市立大学大学院情報科学研究科
-
北村 俊明
広島市立大学
-
市川 裕二
広島市立大学大学院情報科学研究科
-
佐々木 敬泰
三重大学工学部
-
近藤 利夫
三重大学工学部
-
弘中 哲夫
広島市立大学大学院情報科学研究科
-
弘中 哲夫
広島私立大学大学院情報科学研究科情報工学専攻
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