ビットシリアル演算器を用いた再構成型プロセッサDS-HIEにおけるデータフロー生成の最適化手法の提案(設計手法)
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概要
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我々の研究室ではビットシリアル演算器を用いた再構成型プロセッサDS-HIEを開発している.ビットシリアル演算方式では演算のレイテンシが大きくなるため,DS-HIEではスループット重視で性能の向上を目指している.DS-HIEにおいてスループットを向上するためには,DS-HIEに搭載されている各演算器へのデータの入力タイミングが重要となり,DS-HIEへデータフローグラフをマッピングする際にはそれを考慮する必要がある.そこで本稿ではコンパイラによりDS-HIE上にマッピングするのに最適なデータフローグラフへ変換する最適化手法を提案する.提案したアルゴリズムを実装した結果,1次元DCTにおいて最適化する前と比較して約3倍の性能向上となり,演算器使用率はDCTに関しては約15%の増加,FIRに関しては約3%の増加となった.
- 2009-09-10
著者
-
谷川 一哉
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
梅田 賢一
広島市立大学大学院情報科学研究科
-
弘中 哲夫
広島市立大学情報科学部
-
弘中 哲夫
広島市立大学
-
西永 康弘
広島市立大学大学院情報科学研究科
-
谷川 一哉
広島市立大学大学院情報科学研究科
-
弘中 哲夫
広島市立大学大学院情報科学研究科
-
西永 康弘
広島市立大学大学院
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