再構成デバイスとしても動作するメモリLSIの検討(設計手法,リコンフィギャラブルシステム,一般)
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概要
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従来ではSoCをテストするためのテスト回路をチップ内に搭載し,各機能をテストしてきたが,コスト面で不利である.本研究ではSRAMに交互配線を実現する配線を行うことで再構成デバイスとしても動作するメモリLSI(MPLD)を提案する.本稿では,MPLDの一部分である2ポートSRAMを32×4個並べたメモリセルアレイを日立0.18μmCMOSテクノロジを用いて作成した.その結果,メモリ機能と論理回路機能を持ち,メモリとして使用時に500MHz,論理回路として使用時に900MHzの動作周波数で動作する再構成可能なデバイスとして機能することが確認できた.
- 2006-09-07
著者
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
佐藤 正幸
太陽誘電株式会社
-
弘中 哲夫
広島市立大学
-
吉原 理記
広島市立大学大学院情報科学研究科情報工学専攻
-
佐藤 正幸
ジェネシス・テクノロジ株式会社
-
弘中 哲夫
広島市立大学大学院情報科学研究科
-
佐藤 正幸
ジェネシス・テクノロジー株式会社
-
吉原 理記
広島市立大学大学院情報科学研究科情報工学専攻:(現)株式会社ルネサステクノロジ
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