再構成デバイスとしても動作するメモリ(MPLD)の一実装例(リコンフィギャラブルアーキテクチャ1)
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概要
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近年,リコンフィギャラブルデバイスとしてFPGAが広く使用されている.FPGAの問題としてSRAMベースで構成されているにも関わらず,LUTを構成する各SRAMをまとめて1つのメモリとして効率よく使用することはできないことである.この問題を解決する手段として,メモリとしてもLUTとしても機能するMLUTの配置と配線を工夫することでFPGAとほぼ同等の機能を実現するメモリベース論理回路(MPLD)を提案している.本稿では,2ポートSRAMを用いて64個のMLUTで構成されたMPLD全体をROHM0.18μmCMOSテクノロジを用いて設計した.また設計したMPLDを再構成デバイスとして用いて32ビットリップルキャリーカウンタを実現することが出来た.
- 2007-09-13
著者
-
平川 直樹
広島市立大学大学院情報科学研究科情報工学専攻
-
谷川 一哉
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
佐藤 正幸
太陽誘電株式会社
-
弘中 哲夫
広島市立大学
-
吉原 理記
広島市立大学大学院情報科学研究科情報工学専攻
-
谷川 一哉
広島市立大学大学院情報科学研究科
-
佐藤 正幸
ジェネシス・テクノロジ株式会社
-
弘中 哲夫
広島市立大学大学院情報科学研究科
-
佐藤 正幸
ジェネシス・テクノロジー株式会社
-
吉原 理記
広島市立大学大学院情報科学研究科情報工学専攻:(現)株式会社ルネサステクノロジ
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