多倍長浮動小数点演算アクセラレータHP-DSFPの開発と評価(計算機システム)
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概要
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科学技術計算分野では多倍長浮動小数点演算を必要とするアプリケーションとしてループ積分やCG法がある.本研究ではそれらのアプリケーションで使用される多倍長浮動小数点演算を高速化するHP-DSFPアーキテクチャを提案する.HP-DSFPでは多倍長浮動小数点演算器を多数搭載することで,高性能化を実現することを目標とした.そこで,演算器には面積当りの性能を高めることが期待されるディジットシリアル演算を採用した.本研究では,HP-DSFPの詳細な評価を行うためにRohm 0.18μm CMOSテクノロジを利用し,7.5mm角チップへ実装した.実装したHP-DSFPプロセッサは,8倍精度浮動小数点演算を行うFUを48個搭載しており,動作周波数は133MHzである.そのHP-DSFPプロセッサの性能評価のために,パラレル演算器を用いたHP-DSFPプロセッサとの性能比較を行った.その結果,回路面積を同一にした条件において,ディジットシリアル演算器を用いたHP-DSFPプロセッサはパイプライン化したパラレル演算器を用いたHP-DSFPプロセッサより,データ入出力用のピン当りの性能が13倍高かった.
- 2011-01-01
著者
-
谷川 一哉
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
川本 智之
広島市立大学大学院情報科学研究科情報工学専攻
-
伴 大雅
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学情報科学部
-
弘中 哲夫
広島市立大学
-
伴 大雅
広島市立大学大学院情報科学研究科
-
川本 智之
広島市立大学大学院情報科学研究科
-
谷川 一哉
広島市立大学大学院情報科学研究科
-
弘中 哲夫
広島市立大学大学院情報科学研究科
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