ディジットシリアル演算器を用いたFIRフィルタの設計と初期評価(回路方式,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
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概要
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FIRフィルタを従来手法であるパラレル演算器を用いて設計した場合,フィルタ長や演算ビット幅を大きくするとハードウェア資源を使いすぎるという問題があった.そこで本稿では,高精度なFIRフィルタを可能な限り小面積で実現する方法として,ディジットシリアル演算器を用いた手法を紹介し,従来手法との比較評価を行った.
- 社団法人電子情報通信学会の論文
- 2007-11-13
著者
-
谷川 一哉
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学
-
山辺 裕樹
広島市立大学大学院情報科学研究科情報工学専攻
-
谷川 一哉
広島市立大学大学院情報科学研究科
-
弘中 哲夫
広島市立大学大学院情報科学研究科
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