ディジット幅変換機能付きメモリの提案とその応用(リコンフィギャラブルアーキテクチャ1)
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概要
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我々は動的再構成プロセッサにディジットシリアル演算器を使用することで,動的再構成回数を削減させてパフォーマンスの向上を図る研究を行っている.この動的再構成プロセッサに従来のパラレルメモリを使用する場合,ビット幅の変換を行う必要があるという問題があった.そこで我々は従来の1ポートメモリに改良を加え,パラレルデータとディジットシリアルデータの2つのデータアクセスが可能な新しいメモリを提案する.これにより,チップエリアを大幅に小さくできることを証明する.本稿では,前述したメモリの応用例として,我々が提案するメモリとディジットシリアル演算器を組み合わせることで高精度なFIRフィルタをよりコンパクトに実現できることを示す.
- 社団法人電子情報通信学会の論文
- 2007-09-13
著者
-
谷川 一哉
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学大学院情報科学研究科情報工学専攻
-
弘中 哲夫
広島市立大学
-
山辺 裕樹
広島市立大学大学院情報科学研究科情報工学専攻
-
谷川 一哉
広島市立大学大学院情報科学研究科
-
弘中 哲夫
広島市立大学大学院情報科学研究科
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