FAST Corner Detectionの検出パターンの圧縮とFPGAへの実装(画像処理)
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概要
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本稿では,拡張現実(AR)技術の一種であるPTAMで用いられているFAST Corner Detectionの,ストリーム処理を用いたFPGA上での実装を示す.機械学習付きFAST Corner Detectionをコンパクトなハードウェアで実装する上での問題の一つとして,膨大な数のコーナーパターンとのマッチング処理が上げられる.我々は,コーナーパターンの判別式の分割と,回転や反転などの対称性を利用したコーナーパターンの圧縮手法を提案する.提案手法により,組み合わせ回路としてコーナーパターンのマッチング処理が実現できる.FPGA上に実装した機械学習付きFAST Corner Detectionは,リアルタイム処理を実現し,その際のスライス利用率はVirtex-5 FPGAにおいて7〜9%であった.
- 2011-05-05
著者
-
柴田 裕一郎
長崎大学工学部
-
土肥 慶亮
長崎大学大学院生産科学研究科
-
柴田 裕一郎
長崎大学大学院生産科学研究科
-
小栗 清
長崎大学大学院生産科学研究科
-
小栗 清
長崎大学
-
頼田 祐二
長崎大学工学部
-
柴田 裕一郎
長崎大学大学院工学研究科
-
小栗 清
長崎大学大学院工学研究科
-
土肥 慶亮
長崎大学大学院工学研究科生産システム工学専攻
-
土肥 慶亮
長崎大学大学院工学研究科
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