動的パッチ読み出し機構を備えた製造後機能修正可能アクセラレータ
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概要
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SoC の開発コスト増大と開発期間短縮に伴い,仕様変更や設計誤りによる製造後修正を可能とする技術の重要性が増している.最近になり,制御部分をプログラマブルにすることにより製造後修正を可能とするプログラマブルアクセラレータが注目されている.このプログラマブルアクセラレータは制御回路をメモリで実現しているため,結線論理によるアクセラレータに比べて電力効率が非常に低い.そこで,我々は小規模の機能修正を対象に,制御回路の大部分を結線論理で実現した上で部分的にパッチを当てることで制御を修正するプログラマブルアクセラレータを提案している1).しかしながら,この手法は機能修正が小規模の場合にのみ有効であり,大規模な機能修正の場合には効率が悪化してしまう,もしくは機能修正が不可能となってしまう.本稿では,動的パッチ読み出し機構を導入することでこの問題を解決する方式を提案する.
- 2010-09-28
著者
-
藤田 昌宏
富士通研究所人工知能研究部
-
藤田 昌宏
東京大学大学院工学系研究科電子工学
-
吉田 浩章
東京大学大規模集積システム設計教育研究センター
-
吉田 浩章
東北大学電気通信研究所
-
藤田 昌宏
東京大学大規模集積システム設計教育研究センター:科学技術振興機構戦略的創造研究推進事業crest
-
吉田 浩章
東京大学大学院工学系研究科
-
藤田 昌宏
埼玉大学大学院理工学研究科
-
吉田 浩章
東京大学大規模集積システム設計教育研究センター(vdec)|科学技術振興機構戦略的創造研究推進事業crest
-
藤田 昌宏
東京大学大規模集積システム設計教育研究センター(vdec)|科学技術振興機構戦略的創造研究推進事業crest
-
藤田 昌宏
富士通研
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