藤田 昌宏 | 東京大学大規模集積システム設計教育研究センター(vdec)|科学技術振興機構戦略的創造研究推進事業crest
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概要
関連著者
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藤田 昌宏
東京大学大規模集積システム設計教育研究センター(vdec)|科学技術振興機構戦略的創造研究推進事業crest
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藤田 昌宏
東京大学大規模集積システム設計教育研究センター:科学技術振興機構戦略的創造研究推進事業crest
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藤田 昌宏
富士通研
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藤田 昌宏
東京大学大学院工学系研究科電子工学
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藤田 昌宏
富士通研究所人工知能研究部
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吉田 浩章
東京大学大規模集積システム設計教育研究センター(vdec)|科学技術振興機構戦略的創造研究推進事業crest
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吉田 浩章
東京大学大学院工学系研究科
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藤田 昌宏
埼玉大学大学院理工学研究科
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藤田 昌宏
国立札幌病院
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吉田 浩章
東京大学大規模集積システム設計教育研究センター
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吉田 浩章
東北大学電気通信研究所
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松本 剛史
東京大学大規模集積システム設計教育研究センター
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藤田 昌宏
東京大学大規模集積システム設計教育研究センター(VDEC):科学技術振興機構戦略的創造研究推進事業CREST
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藤田 昌宏
東京大学大規模集積システム設計教育研究センター
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藤田 昌宏
東京大学、大規模集積システム設計教育研究センター
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藤田 昌宏
東京大学大規模集積システム設計教育研究センター|科学技術振興機構戦略的創造研究推進事業crest
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西原 佑
東京大学大学院工学系研究科電気系工学専攻
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原田 裕基
東京大学大学院工学系研究科電気系工学専攻
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李 蓮福
東京大学大学院工学系研究科電気系工学専攻
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谷田 英生
東京大学大学院工学系研究科電気系工学専攻
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原田 裕基
東京大学工学部電子工学科
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吉田 浩章
東京大学システム設計教育研究センター(VDEC)
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藤田 昌宏
東京大学システム設計教育研究センター(VDEC)
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山下 茂
立命館大学情報理工学部
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小野 翔平
東京大学工学部電子情報工学科
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山下 茂
立命館大学
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福井 啓
東京大学大学院工学系研究科電気系工学専攻
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李 在城
東京大学大学院工学系研究科電気系工学専攻
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小松 聡
東京大学大規模集積システム設計教育研究センター
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瀬戸 謙修
東京都市大学
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田中 輝明
三菱電機(株)
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佐々木 俊介
東京大学|現在,東芝
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田川 貴聡
東京大学工学部電子工学科
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高 飛
東京大学大学院工学系研究科電子工学専攻
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許 金美
東京大学大学院工学系研究科電子工学専攻
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田川 貴聡
東京大学大学院工学系研究科電気系工学専攻
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Prasad Mukul
Trusted Systems Innovation Group, Fujitsu Laboratories of America
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Rajan Sreeranga
Trusted Systems Innovation Group, Fujitsu Laboratories of America
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Rajan Sreeranga
Trusted Systems Innovation Group Fujitsu Laboratories Of America
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Prasad Mukul
Trusted Systems Innovation Group Fujitsu Laboratories Of America
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佐々木 俊介
東京大学
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佐々木 俊介
東京大学|現在 東芝
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瀬戸 謙修
東京都市大学工学部
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吉田 浩章
東京大学大規模集積システム設計教育研究センター(VDEC):科学技術振興機構戦略的創造研究推進事業CREST
著作論文
- 動的パッチ読み出し機構を備えた製造後機能修正可能アクセラレータ (画像工学)
- 動的パッチ読み出し機構を備えた製造後機能修正可能アクセラレータ (集積回路)
- 動的パッチ読み出し機構を備えた製造後機能修正可能アクセラレータ (信号処理)
- 上位設計記述におけるダイナミックプログラムスライシングを用いたポストシリコンデバッグ支援手法(デバック,組込技術とネットワークに関するワークショップETNET2009)
- 上位設計記述におけるダイナミックプログラムスライシングを用いたポストシリコンデバッグ支援手法(デバッグ,組込技術とネットワークに関するワークショップETNET2009)
- ハードウェアデバッグ支援のためのエラー入出力トレースの上位レベル設計における再現手法(高位レベルテスト・検証,VLSI設計とテスト及び一般)
- 仮想マルチプロセッサモデルに基づく高速SoCプロトタイピング手法 (ディペンダブルコンピューティング)
- 仮想マルチプロセッサモデルに基づく高速SoCプロトタイピング手法 (VLSI設計技術)
- 製造後デバッグのための入出力シーケンススライシング手法(設計/テスト/検証)
- 充足可能性判定に基づくシステムレベルデバッグ支援手法におけるバグモデルの導入による効率化
- 動的パッチ読み出し機構を備えた製造後機能修正可能アクセラレータ
- ループ融合を利用した複数のforループからのパイプラインハードウェア合成
- 1M-5 ワードレベル論理式の充足可能性判定問題を利用したシステムレベル設計デバッグ支援手法(モデリング・上流設計,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 潜在的多様性を考慮したプログラマブルハードウェアの高位合成手法(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
- 発見的手法に基づくスケーラブルなインクリメンタル高位合成 (ディペンダブルコンピューティング)
- 発見的手法に基づくスケーラブルなインクリメンタル高位合成 (VLSI設計技術)
- 高性能SoCプロトタイプのFPGA実装方式の検討 (ディペンダブルコンピューティング)
- 高性能SoCプロトタイプのFPGA実装方式の検討 (VLSI設計技術)
- 設計固有セルライブラリの自動生成手法(論理設計,デザインガイア2009-VLSI設計の新しい大地)
- Increasing yield using partially-programmable circuits (VLSI設計技術)
- 設計固有セルライブラリの自動生成手法(論理設計,デザインガイア2009-VLSI設計の新しい大地-)
- Increasing yield using partially-programmable circuits (ディペンダブルコンピューティング)
- チップ内プログラマブル配線向け形式的検証手法(暗号処理回路,システムオンシリコンを支える設計技術)
- 内部等価点の推定によるルールベース高位検証の高精度化(高位検証,デザインガイア2008-VLSI設計の新しい大地)
- 仮想マルチプロセッサモデルに基づく高速SoCプロトタイピング手法(高位設計1,デザインガイア2010-VLSI設計の新しい大地-)
- 仮想マルチプロセッサモデルに基づく高速SoCプロトタイピング手法(高位設計1,デザインガイア2010-VLSI設計の新しい大地-)
- 高性能SoCプロトタイプのFPGA実装方式の検討(論理設計1,デザインガイア2010-VLSI設計の新しい大地-)
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- システムレベル設計における並列動作の同期に関するデバッグ支援手法(デバック,組込技術とネットワークに関するワークショップETNET2009)
- 上位設計記述におけるダイナミックプログラムスライシングを用いたポストシリコンデバッグ支援手法(デバック,組込技術とネットワークに関するワークショップETNET2009)
- システムレベル設計における並列動作の同期に関するデバッグ支援手法(デバック,組込技術とネットワークに関するワークショップETNET2009)
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- 上位設計記述におけるダイナミックプログラムスライシングを用いたポストシリコンデバッグ支援手法(デバッグ,組込技術とネットワークに関するワークショップETNET2009)
- システムレベル設計における並列動作の同期に関するデバッグ支援手法(デバッグ,組込技術とネットワークに関するワークショップETNET2009)
- 順序回路の上位設計記述における等価性指定の自動化手法(高位検証,FPGA応用及び一般)
- 仕様から自動生成されたプロパティによるプロトコル変換機の形式的検証手法(高位検証,FPGA応用及び一般)
- 発見的手法に基づくスケーラブルなインクリメンタル高位合成(高位設計1,デザインガイア2010-VLSI設計の新しい大地-)
- 発見的手法に基づくスケーラブルなインクリメンタル高位合成(高位設計1,デザインガイア2010-VLSI設計の新しい大地-)
- 2P-1 動的ウェブアプリケーションの操作に対する画面間遷移の網羅的検証(ソフトウェアの検査・検証,学生セッション,ソフトウェア科学・工学,情報処理学会創立50周年記念)
- インクリメンタル高位合成に向けた設計記述間差分の計算手法 (ディペンダブルコンピューティング)
- インクリメンタル高位合成に向けた設計記述間差分の計算手法 (コンピュータシステム)
- インクリメンタル高位合成に向けた設計記述間差分の計算手法
- インクリメンタル高位合成に向けた設計記述間差分の計算手法
- FPGAを用いたSmith-Waterman Algorithmの高速化(科学技術計算)
- 高位合成ツールを利用したハードウェアアルゴリズムの最適化(最適化技術,システム設計及び一般)
- 反例と設計分割に基づく高位設計に対する効率的な設計修正支援手法(検証技術,システム設計及び一般)
- 論理関数の充足不可能性に注目した論理回路デバッグ手法の検討(設計技術,組込み技術とネットワークに関するワークショップETNET2012)
- 論理関数の充足不可能性に注目した論理回路デバッグ手法の検討(設計技術,組込み技術とネットワークに関するワークショップETNET2012)
- 動作レベル・レジスタ転送レベル混在設計記述向け高位合成手法(動作レベル設計と配線手法,システムオンシリコンを支える設計技術)