周波数差検出器を用いた新方式高速引込みPLL
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概要
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高速ディジタル通信におけるタイミング抽出用PLLに要求される高速引込み,低ジッタ特性を実現するため,周波数差検出器(FDD)を用いた新しい高速引込みPLLを提案する.このFDDは入力信号とVCO信号間の位相差を計測し,これによって両信号間の周波数差を検出するものであり,入力信号がNRZ符号の場合でも有効に動作する.本PLLでは,FDD出力信号により低域フィルタの容量を充電し周波数引込みを行った後,通常のPLL動作により位相引込みを行う.本論文では,FDDの基本特性とPLLを縦続接続した場合に重要なパラメータとなるダンピング定数ζがPLLの引込み時間に与える影響を実験およびシミュレーションによって検討し,その結果ζが増大するにつれてFDDによる周波数制御が容易になること,引込み時間が従来の1/10以下に短縮できること,プルインレンジが拡大すること,およびサイクルスリップを抑制する効果があることが明らかになった.
- 社団法人電子情報通信学会の論文
- 1993-10-25
著者
-
谷口 研二
電子情報工学科
-
谷口 研二
大阪大学工学部
-
谷口 研二
久留米工業大学電子情報工学科
-
中司 賢一
九州大学工学部電気情報工学科
-
白濱 弘幸
九州大学工学部
-
谷口 研二
九州大学工学部
-
白濱 弘幸
広島市立大学情報科学部
-
中司 賢一
九州大学
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