フィルタ向け定数乗算のメモリベース実現による低電力化(システムと信号処理及び一般)
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概要
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音声や画像のデジタル信号処理では,入力に定数を掛けて総和を取る形態のデジタルフィルタが多く用いられる.ここではそのような定数乗算に対し,メモリ量と論理のトレードオフを考慮し,高速かつ低電力なメモリベース定数乗算の実現法を提案する.メモリの読出し時の消費電力は,読み出す内容に無関係に一定であり,論理ゲートで構成した乗算回路の各ゲートの出力トグルによる電力を低減できる.入力分割を用いてbit数の少ない乗算結果のみメモリに記憶し,その結果を加算して最終結果を得ることで,直接的な1メモリ実現に比べて,メモリ量の大幅な削減を達成している.本手法に基づく8bitの定数乗算回路を ASICで実現し,電力削減効果を確認した.
- 一般社団法人電子情報通信学会の論文
- 2013-07-04
著者
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