フロアプランを考慮した高位合成のための高速なモジュール配置手法(高位合成,FPGA応用及び一般)
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概要
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近年のLSI設計プロセスの微細化に伴い,配線遅延がゲート遅延に対し相対的に増加してきている.そのため,高位合成の段階においてフロアプランを考慮する必要がある.LSI設計プロセスの微細化の一方で,Time to marketの条件が厳しく設計に割ける時間が短くなってきているため,フロアプランを考慮した高位合成を短時間で実行することが望まれる.本稿では,高位合成とフロアプランを繰り返し実行する環境の中で,高位合成の情報を利用した高速なモジュール配置手法を提案する.本手法はイタレーションしている高位合成を対象としてスケジューリング/FUバインディング工程で得られる情報を利用した構築的手法によって高速かつモジュール間の配線遅延を考慮した配置を実行する.計算機実験によって,対象とする高位合成システムに本手法を組み込んだ場合,システム全体の実行時間を平均で98%削減した.
- 2009-01-22
著者
-
戸川 望
早稲田大学
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
坂田 雅雄
早稲田大学院基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学院基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
戸川 望
早稲田大学院基幹理工学研究科情報理工学専攻
-
佐藤 亘
早稲田大学大学院基幹理工学研究科情報理工学専攻
-
大智 輝
早稲田大学大学院基幹理工学研究科情報理工学専攻
-
柳澤 政生
早稲田大学理工学研究科
-
大附 辰夫
北九州市立大学国際環境工学部情報メディア工学科早稲田大学理工学総合研究センター
-
佐藤 亘
早稲田大学大学院基幹理工学研究科
-
柳澤 政生
早稲田大学
-
佐藤 亘
早稲田大学
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