ビットレベル式変形によるセレクタ帰着型バタフライ演算器の設計と評価(高位合成及び演算器設計,物理設計及び一般)
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概要
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セレクタ論理に帰着させた演算回路は,高速演算回路設計の一手法として提案されている.本稿では,FFTの高性能な要求に対して,バタフライ演算式をビットレベル式変形することで桁上げ伝播処理を削減したセレクタ帰着型バタフライ演算構成を提案する.評価実験を行った結果,提案したバタフライ演算回路は,算術演算子を用いて設計した従来の演算構成と比較して,面積制約を与えた設計において37.1%から49.8%高速化することができることを確認した.
- 社団法人電子情報通信学会の論文
- 2008-09-22
著者
-
戸川 望
早稲田大学
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
外村 元伸
大日本印刷株式会社電子モジュール開発センター
-
外村 元伸
大日本印刷株式会社
-
名村 健
早稲田大学大学院基幹理工学研究科情報理工学専攻
-
大附 辰夫
北九州市立大学国際環境工学部情報メディア工学科早稲田大学理工学総合研究センター
-
柳澤 政生
早稲田大学
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