FPGAを用いた動的再構成可能システムと暗号化アルゴリズムへの応用
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概要
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近年, システムの動作中にシステムの一部の論理を書き換える動的再構成可能システムが研究されている.動的再構成によりハードウェアの高速性とソフトウェアの柔軟性が実現できる.本稿ではディジタル信号処理アプリケーションの高速実行を目的とした動的再構成可能システムを提案する.システムは1つの制御ユニット, 複数の演算ユニットから構成される.制御ユニットは, システムとホスト計算機とのデータ転送、および各演算ユニットを制御する.各演算ユニットには, SRAMタイプのFPGAが1つ搭載され動的再構成される.FPGAの動的再構成機能を取り入れたシステムを構築することで, システムの物理的な論理規模以上のアプリケーションが実行可能となる.DESアルゴリズムをシステムに適用した結果, 計算機によるソフトウェア処理に比較して25倍の処理速度を達成した.
- 社団法人電子情報通信学会の論文
- 2000-03-02
著者
-
戸川 望
早稲田大学
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
羽切 崇
早稲田大学理工学部電子・情報通信学科
-
柳澤 政生
早稲田大学
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