マルチステージクロックゲーテイングにおけるクロック制御回路の共有について(低電力設計,デザインガイア2010-VLSI設計の新しい大地-)
スポンサーリンク
概要
- 論文の詳細を見る
クロックゲーテイングは、順序回路の動的電力削減に有効であることが知られている。本論文では、クロックゲーテイングされたクロックを用いてさらにクロックゲーテイングを行うマルチステージのクロックゲーテイングにおいて、マルチステージのクロック制御信号を抽出し、クロック制御回路を共有する手法について述べる。クロック制御回路の共有により、レジスタおよびクロック制御回路自体のスイッチングアクティビティを削減可能である。本手法は、BDD(二分決定グラフ)を用いて実現され、カウンタ回路やベンチマーク回路に適用された。平均で23%のスイッチングアクティビティの削減が得られた。また、レイアウト後の回路データを用いた電力評価も行なった。
- 2010-11-22
著者
-
木村 晋二
早稲田大学
-
堀山 貴史
埼玉大学大学院理工学研究科
-
堀山 貴史
京都大学大学院情報学研究科
-
堀山 貴史
埼玉大学情報システム工学科
-
堀山 貴史
埼玉大学理工学研究科
-
満 欣
早稲田大学大学院情報生産システム研究科
-
木村 晋二
早稲田大学大学院情報生産システム研究科
-
堀山 貴史
埼玉大学
-
木村 智生
松下電器産業株式会社プラットフォーム開発センター
-
甲斐 康司
松下電器産業株式会社プラットフォーム開発センター
-
甲斐 康司
松下電器産業株式会社プロットフォーム開発センター
-
HORIYAMA Takashi
Saitama University
-
Horiyama Takashi
Graduate School Of Informatics Kyoto University
-
木村 智生
松下電器産業(株) 半導体開発本部 Itシステムlsi開発センター
関連論文
- 1.メディア処理における超低消費電力SoC技術(未来を切り拓く最先端VLSIテクノロジー)
- 最長路問題とJR大都市近郊区間大回りへの応用
- ポリオミノのp4タイリングの列挙
- ALUアレイベースのリコンフィギュラブルプロセッサによるソフトウェア無線機(技術展示/ポスター展示,技術展示,ポスター展示,無線信号処理実装,一般)
- ALU間接続を制限したALUアレイによるリコンフィギュラブルプロセッサの検討(アーキテクチャ, FRGAとその応用及び一般)
- A-3-16 ALU間接続に制限のあるALUアレイによるリコンフィギュラブルプロセッサの検討(A-3. VLSI設計技術)
- カーチューナ向けリコンフィギュラブルアーキテクチャ(リコンフィギャラブルアーキテクチャ2)
- Ordered Binary Decision Diagrams Representing Knowledge-Bases (Models of Computation and Algorithms)
- 二分決定グラフ上での知識表現および正/ホーン関数の認識問題
- 複数の二分決定グラフを用いたNP完全な組合せ問題の解法
- キャリーチェインを用いたマルチオペランド加算器のFPGA向け低電力合成手法
- 正4面体と他の正多面体との共通の辺展開図に関する研究
- 自動クロックゲーティング生成における電力最適化制御信号選択手法
- ALU間接続を制限したALUアレイによるリコンフィギュラブルプロセッサの検討(アーキテクチャ, FRGAとその応用及び一般)
- ALU間接続を制限したALUアレイによるリコンフィギュラブルプロセッサの検討(アーキテクチャ, FRGAとその応用及び一般)
- 秘密分散を用いた安全なVickreyオークション
- 逆探索によるp4タイリングの列挙 (理論計算機科学の深化と応用)
- FPGAを対象とした部分積加算回路の合成について(プロセッサ,システムLSIの応用と要素技術,プロセッサ,DSP,画像処理技術及び一般)
- FPGAを対象とした部分積加算回路の合成について(プロセッサ,システムLSIの応用と要素技術,プロセッサ,DSP,画像処理技術及び一般)
- FPGAを対象とした部分積加算回路の合成について(プロセッサ,システムLSIの応用と要素技術,プロセッサ,DSP,画像処理技術及び一般)
- 論理関数の畳み込み機構を導入した省面積FPGAの実現と評価
- 8C45 ことばによる手話単語の記述と三次元表現
- 非線形方程式と整数解の探索に基づく高位合成向けビット長最適化(検証・理論, 組込技術とネットワークに関するワークショップ)
- 非線形方程式と整数解の探索に基づく高位合成向けビット長最適化
- 非線形方程式と整数解の探索に基づく高位合成向けビット長最適化(検証・理論, 組込技術とネットワークに関するワークショップ)
- 非線形方程式と整数解の探索に基づく高位合成向けビット長最適化
- マルチステージクロックゲーテイングにおけるクロック制御回路の共有について(低電力設計,デザインガイア2010-VLSI設計の新しい大地-)
- マルチステージクロックゲーティングにおけるクロック制御回路の共有について(低電力設計,デザインガイア2010-VLSI設計の新しい大地-)
- 1-D-5 最長路問題と最大経路差問題 : その解法とJR大都市近郊区間大回りへの応用(離散・組合せ最適化(2))
- 自動パイプライン化を用いた FPGA におけるプロトタイピングの高速化
- 簡易高位合成を用いたカスタマイズ可能なハードウェア/ソフトウェア分割評価手法(高位合成及び検証,信号処理,LSI,及び一般)
- 簡易高位合成を用いたカスタマイズ可能なハードウェア/ソフトウェア分割評価手法(高位合成及び検証,信号処理,LSI,及び一般)
- 簡易高位合成を用いたカスタマイズ可能なハードウェア/ソフトウェア分割評価手法(高位合成及び検証,信号処理,LSI,及び一般)
- スイッチング確率を考慮したprefix graph合成手法の改良について(合成及び演算器最適化,システム設計及び一般)
- スイッチング確率を考慮したprefix graph合成手法の改良について(システム設計及び一般)
- Lingのキャリー計算に基づくparallel prefix adder合成について(論理・レイアウト最適化,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- Lingのキャリー計算に基づくparallel prefix adder合成について(論理・レイアウト最適化,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- Lingのキャリー計算に基づくparallel prefix adder合成について(論理・レイアウト最適化,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- 回路変更を用いたプロトタイプ設計検証における高速化(検証)
- 回路変更を用いたプロトタイプ設計検証における高速化(検証)
- 回路変更を用いたプロトタイプ設計検証における高速化(検証,組込技術とネットワークに関するワークショップETNET2007)
- 回路変更を用いたプロトタイプ設計検証における高速化(検証,組込技術とネットワークに関するワークショップETNET2007)
- TK-6 情報・電気・電子グローバルCOEの戦略と計画(大会委員会企画)
- TK-6 情報・電気・電子グローバルCOEの戦略と計画(大会委員会企画)
- TK-6 情報・電気・電子グローバルCOEの戦略と計画(大会委員会企画)
- TK-6 情報・電気・電子グローバルCOEの戦略と計画(大会委員会企画)
- TK-6 情報・電気・電子グローバルCOEの戦略と計画(大会委員会企画)
- TK-6 情報・電気・電子グローバルCOEの戦略と計画(大会委員会企画)
- TK-6 情報・電気・電子グローバルCOEの戦略と計画(大会委員会企画)
- 自動パイプライン化を用いたFPGAにおけるプロトタイピングの高速化
- 動画像処理向け高速公開鍵暗号LSIアーキテクチャ(セキュリティ・暗号1, 組込技術とネットワークに関するワークショップ)
- 動画像処理向け高速公開鍵暗号LSIアーキテクチャ
- 動画像処理向け高速公開鍵暗号 LSI アーキテクチャ(セキュリティ・暗号1, 組込技術とネットワークに関するワークショップ)
- 動画像処理向け高速公開鍵暗号LSIアーキテクチャ
- 平面グラフにおけるHajos Calculusの複雑さについて
- FOCS 2008報告
- 上位からの時差入力下での最適並列加算器
- 除算を表現する二分決定グラフの指数下界
- 抽象解釈手法に基づく変数の相互関係解析とそのデータパス最適化への応用(システム設計及び一般)
- 抽象解釈手法に基づく変数の相互関係解析とそのデータパス最適化への応用(システム設計および一般)
- 論理関数の畳み込み機構を導入した省面積FPGAの実現と評価
- 論理関数の畳み込み機構を導入した省面積FPGAの実現と評価(FPGAとその応用及び一般)
- 動的再構成可能配線について(FPGA・低消費電力設計・システムレベル合成,システム設計及び一般)
- 動的再構成可能配線について(FPGA・低消費電力設計・システムレベル合成,システム設計及び一般)
- DS-1-7 いかなる辺展開でも正多面体は重ならない(DS-1.COMP学生シンポジウム,シンポジウムセッション)
- いかなる辺展開でも正多面体は重なりを持たない (計算機科学とアルゴリズムの数理的基礎とその応用)
- 正4面体と正6面体との共通の展開図の構成に関する研究
- 正多面体の展開図における最小/最大の直径、幅および包囲長方形について
- CCTomato : CMOS論理セルの特性抽出ツールの開発
- CCTomato : CMOS論理セルの特性抽出ツールの開発
- CCTomato : CMOS論理セルの特性抽出ツールの開発
- プロセッサにおける配線の再構成可能性の利用について(FPGAとその応用及び一般)
- プロセッサにおける配線の再構成可能性の利用について(FPGAとその応用及び一般)
- プロセッサにおける配線の再構成可能性の利用について(FPGAとその応用及び一般)
- 次状態関数処理に基づく高速不揮発メモリに対する書き込み最適化(論理設計2,システムオンシリコンを支える設計技術)
- 浮動小数点演算と演算チェイニングを考慮した粗粒度再構成可能ハードウェア(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 浮動小数点演算と演算チェイニングを考慮した粗粒度再構成可能ハードウェア(システムオンシリコン設計技術並びにこれを活用したVLSI)
- いかなる辺展開でも正多面体は重なりを持たない
- 一般化並列カウンタを用いたマルチオペランド加算器合成問題のILPによる定式化(論理設計,システム設計及び一般)
- 論理素子の制御値に基づく多段のパワーゲーティング(論理設計,システム設計及び一般)
- 正多面体の展開図における最小/最大の直径、幅および包囲長方形について
- A-3-8 メモリを用いた算術演算回路のFPGA実現とその電力評価(A-3.VLSI設計技術,一般セッション)
- A-3-10 状態遷移の解析に基づく書込み制御回路の検討(A-3.VLSI設計技術,一般セッション)
- 状態遷移の解析に基づく磁気フリップフロップ書き込み制御手法(システム設計,システム設計及び一般)
- A-3-7 差分を用いた不揮発メモリの書き込み回数削減(A-3.VLSI設計技術)
- IL1およびIL2キャッシュに不揮発メモリを利用した二階層キャッシュにおける消費エネルギーの評価(システムと信号処理及び一般)
- IL1およびIL2キャッシュに不揮発メモリを利用した二階層キャッシュにおける消費エネルギーの評価(システムと信号処理及び一般)
- フィルタ向け定数乗算のメモリベース実現による低電力化(システムと信号処理及び一般)
- IL1およびIL2キャッシュに不揮発メモリを利用した二階層キャッシュにおける消費エネルギーの評価(システムと信号処理及び一般)
- 最大ハミング距離を制限した符号とこれを用いた不揮発メモリの書き込み削減手法(システムと信号処理及び一般)
- 最大ハミング距離を制限した符号とこれを用いた不揮発メモリの書き込み削減手法(システムと信号処理及び一般)
- 最大ハミング距離を制限した符号とこれを用いた不揮発メモリの書き込み削減手法(システムと信号処理及び一般)
- フィルタ向け定数乗算のメモリベース実現による低電力化(システムと信号処理及び一般)
- フィルタ向け定数乗算のメモリベース実現による低電力化(システムと信号処理及び一般)
- IL1およびIL2キャッシュに不揮発メモリを利用した二階層キャッシュにおける消費エネルギーの評価(システムと信号処理及び一般)
- フィルタ向け定数乗算のメモリベース実現による低電力化(システムと信号処理及び一般)
- 差分を用いた不揮発メモリの書込み回数削減による低電力回路設計(性能・製造性考慮手法,FPGA応用及び一般)
- 状態遷移の解析に基づく磁気フリップフロップ書き込み制御手法
- 最大ハミング距離を制限した符号とこれを用いた不揮発メモリの書き込み削減手法(システムと信号処理及び一般)
- 差分を用いた不揮発メモリの書込み回数削減による低電力回路設計(性能・製造性考慮手法,FPGA応用及び一般)