マルチステージクロックゲーティングにおけるクロック制御回路の共有について(低電力設計,デザインガイア2010-VLSI設計の新しい大地-)
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概要
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クロックゲーティングは、順序回路の動的電力削減に有効であることが知られている。本論文では、クロックゲーティングされたクロックを用いてさらにクロックゲーティングを行うマルチステージのクロックゲーティングにおいて、マルチステージのクロック制御信号を抽出し、クロック制御回路を共有する手法について述べる。クロック制御回路の共有により、レジスタおよびクロック制御回路自体のスイッチングアクティビティを削減可能である。本手法は、BDD(二分決定グラフ)を用いて実現され、カウンタ回路やベンチマーク回路に適用された。平均で23%のスイッチングアクティビティの削減が得られた。また、レイアウト後の回路データを用いた電力評価も行なった。
- 2010-11-22
著者
-
木村 晋二
早稲田大学
-
堀山 貴史
埼玉大学大学院理工学研究科
-
堀山 貴史
京都大学大学院情報学研究科
-
堀山 貴史
埼玉大学情報システム工学科
-
堀山 貴史
埼玉大学理工学研究科
-
満 欣
早稲田大学大学院情報生産システム研究科
-
木村 晋二
早稲田大学大学院情報生産システム研究科
-
堀山 貴史
埼玉大学
-
木村 智生
松下電器産業株式会社プラットフォーム開発センター
-
甲斐 康司
松下電器産業株式会社プラットフォーム開発センター
-
甲斐 康司
松下電器産業株式会社プロットフォーム開発センター
-
HORIYAMA Takashi
Saitama University
-
Horiyama Takashi
Graduate School Of Informatics Kyoto University
-
木村 智生
松下電器産業(株) 半導体開発本部 Itシステムlsi開発センター
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