一般化並列カウンタを用いたマルチオペランド加算器合成問題のILPによる定式化(論理設計,システム設計及び一般)
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概要
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FPGA上でマルチオペランド加算を実現する場合,桁上げを伝播させずにオペランド数を圧縮する回路を一般化並列カウンタを用いてLUT上に実現する方が,キャリーチェインを用いた加算木構成よりも,高速に実現できることが最近の研究で分かってきた.本稿では,オペランド数圧縮回路を構築する過程を,用いるGPCの種類と個数を決定する過程とそれに基づいて回路を構築する過程に分割し,前半部分を整数線形計画問題として定式化し段数および要素数の最小化を行う手法を提案する.
- 2011-05-11
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