パイプラインプロセッサ向けカスケードTMRの欠陥レベル評価に関する一考察(ディペンダブルコンピューティングシステム及び一般)
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概要
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本稿では,パイプラインプロセッサのステージ毎に3重冗長構成(triple modular redundancy : TMR)を適用したカスケードTMR構成の有効性について,良品1チップあたりの面積および欠陥レべルの観点から評価を行う.与えられた欠陥密度,ステージ数に基づいて,良品1チップあたりの面積を解析的に導出する.また,各ステージにおけるモジュールおよびボータは個別にテストされ,テスト結果に基づいてチップのパスフェール判定が行われると仮定し,故障カバレージを考慮して欠陥レペルを解析的に導出する.数値例から,カスケードTMRの適用によって,製造歩留りが低い場合において良品1チップあたりの面積および欠陥レべルが改善されることを示す.また,良品1チップあたりの面積または欠陥レべルが最小となるステージ数が存在する場合があることを示す.
- 2011-04-05
著者
-
新井 雅之
首都大学東京システムデザイン学部
-
岩崎 一彦
首都大学東京システムデザイン学部
-
新井 雅之
首都大学東京システムデザイン学部|首都大学東京大学院システムデザイン研究科
-
岩崎 一彦
首都大学東京システムデザイン学部|首都大学東京大学院システムデザイン研究科
-
新井 雅之
首都大学東京 システムデザイン学部
-
岩崎 一彦
首都大学東京 システムデザイン学部
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