高性能マイクロプロセッサの高速シミュレータの設計と実装(ARC-2:シミュレーション技術)(2003年並列/分散/協調処理に関する『松江』サマー・ワークショップ(SWoPP松江2003))
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概要
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集積回路技術の進歩に伴い,マイクロプロセッサの構造は高度化・複雑化している.このような高度なマイクロプロセッサの研究・開発や,それを組み込んだ機器のハードウェア・ソフトウェア協調設計においては,その機能・性能を検証するためのcycle accurate なシミュレータが不可欠である.しかし,現状のシミュレータは一般に低速である.そこで,われわれはスケジューリング計算に計算再利用技術を適用したシミュレーション高速化を提案する.高性能マイクロプロセッサのシミュレーションでは,スケジューリング計算がもっとも時間コストが大きい.一方,スケジューリング計算には局所性がある.たとえば最内ループでは少数のスケジューリングパターンが繰り返されることは明らかである.そこで,多数回繰り返されるスケジューリングパターンを検出した場合に,スケジューリング計算の結果を保存することにより,それ以降の同じ結果になる計算を省略し高速化できる.SPEC CPU95ベンチマークを用いて評価を行った結果,シミュレーション速度の最大6.2倍の向上が確認できた.
- 一般社団法人情報処理学会の論文
- 2003-08-05
著者
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