SRAMベースFPGAにおける耐ソフトエラーLUT構成法(リコンフィギャラブルシステム2,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
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概要
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近年,プロセス微細化によりソフトエラーの問題がさらに深刻化するといわれている.特にSRAMにおいてソフトエラーの問題は深刻となってきており,様々な対策が講じられてきている.本稿では,SRAMベースFPGAの論理を実現するLUTを構成するメモリにXORの性質を利用し,3重化の多数決論理を2倍のメモリコストで実現する手法を提案する.本提案はランダム1ビットエラーの修正が可能であり,エラー耐性についても3重化に近い性能であることを確認した.
- 社団法人電子情報通信学会の論文
- 2007-11-15
著者
-
中島 康彦
奈良先端科学技術大学院大学情報科学研究科
-
中田 尚
奈良先端科学技術大学院大学情報科学研究科
-
中西 正樹
奈良先端科学技術大学院大学情報科学研究科
-
山下 茂
立命館大学情報理工学部
-
中田 尚
奈良先端科学技術大学院大学
-
山下 茂
奈良先端科学技術大学院大学 情報科学研究科
-
中島 康彦
奈良先端科学技術大学院大学
-
里山 宏平
奈良先端科学技術大学院大学
-
中島 康彦
富士通(株)
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