演算器アレイにおける冗長化オーバヘッドの少ない高信頼化手法の提案
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概要
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我々は柔軟な故障耐性を持つ高信頼演算器アレイ型アクセラレータ EReLA を提案している.本構成の冗長実行では,従来の命令写像方式では利用されない演算器を有効利用することで,回路規模の増加を防ぎつつ,冗長実行を可能としている.しかしながら,単純に空き演算器に冗長命令を複製し,演算を行う場合,データ伝搬の為に必要となるパイプラインレジスタ(以降,伝搬レジスタと呼ぶ)が単純に 2 倍程度必要となる.また,伝搬レジスタの増加がセレクタ回路の大規模化を招き,回路遅延も懸念されるため,冗長化オーバヘッドの少ない高信頼化手法が強く求められている.そこで,本稿では演算結果の一時チェックを効率的に利用し,データパスを伝搬距離に応じて1つの共有パスにまとめ,伝搬レジスタを削減することを提案している.画像処理ベンチマークプログラムを対象に各手法について評価した結果,伝搬距離が5以上の場合,データパスをパスをマージすることで,効率的な伝搬レジスタ削減が可能になるという知見を得た.
- 2012-07-25
著者
-
姚 駿
奈良先端科学技術大学院大学情報科学研究科
-
中島 康彦
奈良先端科学技術大学院大学情報科学研究科
-
中島 康彦
奈良先端科学技術大学院大学
-
中島 康彦
富士通株式会社
-
姚 駿
奈良先端科学技術大学院大学
-
中島 康彦
富士通(株)
-
Tanvir Ahmed
Nara Institute Of Science & Technology
-
大谷 友哉
奈良先端科学技術大学院大学
-
Tanvir Ahmed
奈良先端科学技術大学院大学
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