時間軸分割並列マイクロプロセッサシミュレータの高速化と評価(シミュレーション・エミュレーション,「ハイパフォーマンスコンピューティングとアーキテクチャの評価」に関する北海道ワークショップ(HOKKE-2007))
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概要
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集積回路技術の進歩に伴い,マイクロプロセッサの構造は高度化・複雑化している.高度なマイクロプロセッサの性能検証にはクロックレベルでのシミュレーションが不可欠であるが,現存するシミュレータは一般に低速であり,研究開発の大きな障害となっている.そこで我々は,シミュレーション過程を時間軸方向に分割,並列化することによるマイクロプロセッサのクロックレベルシミュレーションの高速化手法を提案している.並列シミュレーションは,分割点でのマシン状態を一致させること,もしくは分割された区間のシミュレーションの正当性をシミュレーション履歴によって検証することにより,精度を落とすことなく高速化を行う.本論文では,マシン状態を近似的にもとめる命令レベルのシミュレーション部分を高速化するために,ワークロード最適化シミュレーション技術を適用することを提案した. SPEC CPU95を用いて評価した結果,SimplcScalarのsim-outordcrに対して,最大9.41倍,平均6.4倍のシミュレーション速度の向上が確認できた.
- 一般社団法人情報処理学会の論文
- 2007-03-01
著者
-
中島 浩
京都大学学術情報メディアセンター
-
中田 尚
奈良先端科学技術大学院大学
-
高崎 透
豊橋技術科学大学
-
矢野 聖宗
豊橋技術科学大学
-
中田 尚
豊橋技術科学大学
-
中島 浩
(現)京都大学
-
中田 尚
東京大学
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