1チップデータ駆動形プロセッサのアーキテクチャ評価
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概要
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32ビット浮動小数点演算器を有するシングルチップ・データ駆動形プロセッサ(RAPlD)のアーキテクチャ評価について報告する.RAPIDは,並列分散システムの要素プロセッサとして開発したもので,世代・カラー識別子を用いて多重処理を実現する動的データ駆動方式を基本とし,ハッシュ衝突による性能低下のない待ち合わせメモリ,オンチップべクトル演算機構,およびスーパパイプラインによる高スループットを特徴とする最高性能50MFLOPSのマイクロプロセッサである.本論文では,スカラ演算時,およびスカラ演算とべクトル演算の同時実行時の理論的な性能限界について検討を加える.その後,シングルプロセッサレべルでの評価として,機能シミュレータを用いて行ったWhetstoneべンチマーク(20MWIPS)と信号処理プログラムFFT(1024点2.5m秒)の結果を示しながら,ハッシュ衝突時の退避領域として待ち合わせメモリ内に設けた32エントリの連想メモリ,およびオンチップべクトル演算機能の有効性について述べる.
- 一般社団法人情報処理学会の論文
- 1993-04-15
著者
-
小守 伸史
三菱電機(株)先端技術総合研究所
-
小守 伸史
三菱電機(株)
-
佐藤 尚和
三菱電機(株)システムLSI事業化推進センター
-
田村 俊之
三菱電機先端技術総合研究所
-
坪田 浩乃
三菱電機(株) 先端技術総合研究所
-
田村 俊之
三菱電機(株) 先端技術総合研究所
-
寺田 浩詔
大阪大学工学部情報システム工学科
-
高田 英裕
三菱電機(株)lsi研究所lsi設計技術第三部
-
田村 俊之
三菱電機(株)先端技術総合研究所
-
浅井 文康
三菱電機(株)LSI研究所LSI設計技術第三部
-
瀬口 禎浩
三菱電機(株)LSI研究所LSI設計技術第三部
-
坪田 浩乃
三菱電機(株)先端技術総合研究所
-
佐藤 尚和
三菱電機(株)lsi研究所lsi設計技術第三部
-
寺田 浩詔
大阪大学工学部
-
寺田 浩詔
大阪大学
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