VLIWメディアプロセッサD30Vアーキテクチャ

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概要

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• MPEG2のようなマルチメディア・アプリケーションを実行するためには、プロセッサに高い演算処理能力が要求される。この要求を満たす、2ウェイのVLIWと2ウェイのSIMDアーキテクチャで、250MHz動作時に1.0GOPSを有するメディアプロセッサコアD30Vを開発した。D30Vでは4演算/1クロックサイクルを行う4ステージパイプラインを2本備え、インターロック処理を避けるためにパイプ内とパイプ間で様々なバイパス処理を可能とした。これによりMPEG2のビデオデコード処理の性能を約20%向上させ、ソフトウェアによるリアルタイムデコード処理を可能とした。本報告では、D30Vの命令セットアーキテクチャと、これを実現するパイプラインアーキテクチャーについて説明する。

• 社団法人電子情報通信学会の論文
• 1997-08-21

著者

• 島津 之彦

  三菱電機(株)LSI研究所

• 吉田 豊彦

  三菱電機株式会社システムlsi事業化推進センター

• 吉田 豊彦

  三菱電機(株)

• 島津 之彦

  三菱電機 システムlsi事業化推進セ

• 山田 朗

  三菱電機(株)

• 高田 英裕

  三菱電機

• 高田 英裕

  三菱電機(株)lsi研究所lsi設計技術第三部

• 毛利 篤史

  三菱電機(株)情報技術総合研究所

• ホルマン エドガー

  三菱電機(株)システムLSI開発研究所

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